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㈠ 下图(a)为由4个维持阻塞D触发器组成的4位右移位寄存器。4个D触发器共用一个时钟脉冲信号,因此为同步时序逻辑电路。数码由最左边的FF0的Dr端串行输入。

图 由D触发器组成的单向移位寄存器

(a) 右移位寄存器(b) 左移位寄存器

工作原理:
每一个触发器的输出→其右边触发器的输入,则对应每一个CP上升沿,数据右移一位。

右移位寄存器的状态表:

移位脉冲

上一个:NTRL03TU 下一个:1771-IQC

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