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351A21NNF
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同步时序逻辑电路设计又称 同步时序逻辑电路综合， 其基本指导思想是用尽可能少的触发器和门电路来完成设计。
同步时序电路设计的一般步骤为：
作原始状态图和状态表
对原始状态表化简
状态分配
选定触发器，求出输出函数和激励函数表达式
画出逻辑电路图
同步时序电路设计的一般步骤为：
作原始状态图和状态表
对原始状态表化简
状态分配
选定触发器，求出输出函数和激励函数表达式
画出逻辑电路图
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