2)分频器电路
通常,数字钟的晶体振荡器输出频率较高,为了得到 0.1Hz的秒信号输入,需要对振荡器的输出信号进行分频。 须设计一个五进制计数器 ,对频率为 50HZ 的时钟脉冲进行五分频,在输出端 QD 取得周期为 0.1S 的矩形脉冲,作为 时间计数单元的时钟输入。 用集成异步计数器 74LS90 实现,电路图如下:
图2 74ls90引脚图及构成五进制计数器
3)时间计数单元
时间计数单元有时计数、分计数和秒计数等几个部分。 要实现 0.1 秒计数,须设计一个 10 进制计数器;要实现秒计数,须设计一个 60 进制计数器;要实现分计数,须设计一个 10 进制计数器,这里选用 74LS90 实现。
表1 74LS90功能表
输 入
上一个:3HAC021541-004
下一个:3HAC021570-008
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