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IPESW11
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脉异步时序电路的设计步骤基本上与同步时序电路的设计步骤一样。但须特别考虑：
⑴ 输入信号 x 及触发器的时钟信号 CLK 取值为:
0—无脉冲 1—有脉冲
⑵ 采用简化的状态表和状态图。
⑶ 在确定控制函数时，不仅要确定各触发器的控制输入信号，而且还需确定各触发器的时钟信号。
?时钟信号 CLK 应是现态 Qn及输入 x 的函数.
?各触发器的输入控制信号 X应尽量使其仅为现态Qn 的函数，
这样使其具有保证电路正常工作所需的建立和保持时间。
⑷ 状态不变时，令 CLK = 0，这样触发器的数据端变量就可认为是无关最小项d ，这有利于函数的化简
例1 用D触发器设计一个“x1 – x1 – x2 ”序列检测器。
⑴ 建立原始状态图和状态表如图1所示。
图1 状态图
表
例1 状态表
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