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强调指出异步置0信号时不受时钟信号控制,只要出现R′=0的信号,触发器的输出端立刻被置为Q=0,而与此刻输入信号和CLK的状态无关。分析此电路时,改变书中用文字描述的分析方法,而是按照上面列表格的方式,设定初始状态后,一步步分析每来一个脉冲时输出端的状态,之后将输出端状态画出其波形图,同时很直观地看出,这个电路其实是触发器的一个实际应用----三分频电路。学习中遇到类似的问题,可以举一反三,触类旁通。如果进一步研究,引导学生如何构造一个占空比为1:1的三分频电路。

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